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    查广西11选5开奖公告: 缓冲区并发访问方法及装置.pdf

    摘要
    申请专利号:

    广西11选5大小走势图 www.fnjpv.tw CN201510315473.5

    申请日:

    2015.06.10

    公开号:

    CN104881258A

    公开日:

    2015.09.02

    当前法律状态:

    驳回

    有效性:

    无权

    法律详情: 发明专利申请公布后的驳回IPC(主分类):G06F 3/06申请公布日:20150902|||实质审查的生效IPC(主分类):G06F 3/06申请日:20150610|||公开
    IPC分类号: G06F3/06; G06F13/16 主分类号: G06F3/06
    申请人: 北京金山安全软件有限公司
    发明人: 潘洪安
    地址: 100085北京市海淀区小营西路33号二层东区
    优先权:
    专利代理机构: 北京柏杉松知识产权代理事务所(普通合伙)11413 代理人: 马敬; 项京
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201510315473.5

    授权公告号:

    ||||||

    法律状态公告日:

    2019.05.03|||2015.09.30|||2015.09.02

    法律状态类型:

    发明专利申请公布后的驳回|||实质审查的生效|||公开

    摘要

    本发明实施例公开了一种缓冲区并发访问方法及装置。该方法应用于缓冲区并发访问架构中的被CPU唤醒的写线程/读线程,该架构包括:N个线程访问组,每个线程访问组对应各自的缓冲区子区域,每个线程访问组均包括:一个读线程和一个写线程,读线程和写线程分别对应有各自的用于获得缓冲区的全局锁的条件变量;未被唤醒的写线程和读线程的条件变量均处于阻塞状态;该方法包括:调用被CPU解除阻塞的条件变量以获得缓冲区的全局锁;对自身所对应的缓冲区子区域执行访问操作;在访问操作结束后,释放所调用的条件变量,以使得CPU能够解除执行下一次访问操作所需的写线程/读线程所对应条件变量的阻塞??杉?,本方案能够提高缓冲区访问效率。

    权利要求书

    权利要求书
    1.  一种缓冲区并发访问方法,其特征在于,应用于缓冲区并发访问架构中被CPU唤醒的写线程/读线程;所述缓冲区并发访问架构包括:N个线程访问组,其中,每个线程访问组对应各自的缓冲区子区域,并且,每个线程访问组均包括:一个读线程和一个写线程,所述读线程和所述写线程分别对应有各自的用于获得所述缓冲区的全局锁的条件变量;并且,所述N个线程访问组内的当前被唤醒的写线程/读线程之外的写线程所对应的条件变量和读线程所对应的条件变量均处于阻塞状态;所述方法包括:
    调用被CPU解除阻塞的条件变量以获得所述缓冲区的全局锁;
    对所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作;
    在访问操作执行完毕后,释放所调用的所述条件变量,以使得所述CPU在获知当前被唤醒的写线程/读线程释放所述条件变量后,能够解除执行下一次访问操作所需的写线程/读线程所对应的条件变量的阻塞。

    2.  根据权利要求1所述的方法,其特征在于,当写线程被CPU唤醒时,所述对所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作,包括:
    对被CPU唤醒的写线程所对应的缓冲区子区域执行数据写入操作;
    当读线程被CPU唤醒时,所述对所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作,包括:
    对被CPU唤醒的读线程所对应的缓冲区子区域执行数据读取操作。

    3.  根据权利要求1所述的方法,其特征在于,所述对所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作之前,还包括:
    判断所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域是否处于所需的访问状态,如果是,对所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作;
    在访问操作执行完毕后,所述方法还包括:
    将所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域设置为与访问操 作对应的访问状态。

    4.  根据权利要求3所述的方法,其特征在于,当写线程被CPU唤醒时:
    所述判断所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域是否处于所需的访问状态,包括:
    判断所述被CPU唤醒的写线程所对应的缓冲区子区域是否处于数据未写入状态;
    所述将所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域设置为与访问操作对应的访问状态,包括:
    将所述被CPU唤醒的写线程所对应的缓冲区子区域设置为数据已写入状态;
    当读线程被CPU唤醒时:
    所述判断所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域是否处于所需的访问状态,包括:
    判断所述被CPU唤醒的读线程所对应的缓冲区子区域是否处于数据已写入状态;
    所述将所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域设置为与访问操作对应的访问状态,包括:
    将所述被CPU唤醒的读线程所对应的缓冲区子区域设置为数据未写入状态。

    5.  一种缓冲区并发访问装置,其特征在于,应用于缓冲区并发访问架构中被唤醒的写线程/读线程;所述缓冲区并发访问架构包括:N个线程访问组,其中,每个线程访问组对应各自的缓冲区子区域,并且,每个线程访问组均包括:一个读线程和一个写线程,所述读线程和所述写线程分别对应有各自的用于获得所述缓冲区的全局锁的条件变量;并且,所述N个线程访问组内的当前被唤醒的写线程/读线程之外的写线程所对应的条件变量和读线程所对应的条件变量均处于阻塞状态;所述装置包括:
    条件变量调用???,用于调用被CPU解除阻塞的条件变量以获得所述缓冲区的全局锁;
    访问操作执行???,用于对所述被CPU唤醒的写线程/读线程所对应的缓冲 区子区域执行访问操作;
    条件变量释放???,用于在访问操作执行完毕后,释放所调用的所述条件变量,以使得所述CPU在获知当前被唤醒的写线程/读线程释放所述条件变量后,能够解除执行下一次访问所需的写线程/读线程所对应的条件变量的阻塞。

    6.  根据权利要求5所述的装置,其特征在于,所述访问操作执行???,包括:
    数据写入操作执行单元,用于当写线程被CPU唤醒时,对所述被CPU唤醒的写线程所对应的缓冲区子区域执行数据写入操作;
    数据读取操作执行单元,用于当读线程被CPU唤醒时,对所述被CPU唤醒的读线程所对应的缓冲区子区域执行数据读取操作。

    7.  根据权利要求5所述的装置,其特征在于,还包括:
    访问状态判断???,用于在所述访问操作执行??槎运霰籆PU唤醒的写线程/读线程所对应的缓冲区子区域执行访问操作之前,判断所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域是否处于所需的访问状态,如果是,触发所述访问操作执行???;
    访问状态设置???,用于在访问操作执行完毕后,将所述被CPU唤醒的写线程/读线程所对应的缓冲区子区域设置为与访问操作对应的访问状态。

    8.  根据权利要求7所述的装置,其特征在于,所述访问状态判断???,包括:
    第一访问状态判断单元,用于当写线程被CPU唤醒时,在访问操作执行??槎运霰籆PU唤醒的写线程所对应的缓冲区子区域执行访问操作之前,判断所述被CPU唤醒的写线程所对应的缓冲区子区域是否处于数据未写入状态,如果是,触发所述访问操作执行???;
    第二访问状态判断单元,用于当读线程被CPU唤醒时,在访问操作执行??槎运霰籆PU唤醒的读线程所对应的缓冲区子区域执行访问操作之前,判断所述被CPU唤醒的读线程所对应的缓冲区子区域是否处于数据已写入状态,如果是,触发所述访问操作执行???;
    所述访问状态设置???,包括:
    第一访问状态设置单元,用于当写线程被CPU唤醒时,在访问操作执行完毕后,将所述被CPU唤醒的写线程所对应的缓冲区子区域设置为数据已写入状态;
    第二访问状态设置单元,用于当读线程被CPU唤醒时,在访问操作执行完毕后,将所述被CPU唤醒的读线程所对应的缓冲区子区域设置为数据未写入状态。

    关 键 词:
    缓冲区 并发 访问 方法 装置
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