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    广西11选5选号技巧: 高速缓存多位数据翻转错误的检测及容错装置与方法.pdf

    摘要
    申请专利号:

    广西11选5大小走势图 www.fnjpv.tw CN201510507410.X

    申请日:

    2015.08.19

    公开号:

    CN105005513A

    公开日:

    2015.10.28

    当前法律状态:

    授权

    有效性:

    有权

    法律详情: 授权|||实质审查的生效IPC(主分类):G06F 11/10申请日:20150819|||公开
    IPC分类号: G06F11/10 主分类号: G06F11/10
    申请人: 首都师范大学
    发明人: 张伟功; 邱柯妮; 丁丽华; 王晶; 李涛; 王珍珍; 董佳琪; 朱晓燕; 徐远超
    地址: 100048北京市海淀区西三环北路56号
    优先权:
    专利代理机构: 代理人:
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201510507410.X

    授权公告号:

    ||||||

    法律状态公告日:

    2017.12.05|||2015.11.25|||2015.10.28

    法律状态类型:

    授权|||实质审查的生效|||公开

    摘要

    一种嵌入式微处理器高速缓存多位数据翻转错误的检测及容错装置与方法,其特征在于:所述检测及容错装置包括标记BCH编码器、Cache标记存储器、标记BCH校验器、数据BCH编码器、Cache数据存储器、数据BCH校验器、Cache控制器和命中控制器,依据所选用的Cache管理策略,使用BCH编码及Cache重装方法对Cache标记存储器和Cache数据存储器中的多位数据错误进行检测与容错。

    权利要求书

    权利要求书
    1.  一种嵌入式微处理器高速缓存多位数据翻转错误的检测及容错装置,其特征在于:包括标记BCH编码器、Cache标记存储器、标记BCH校验器、数据BCH编码器、Cache数据存储器、数据BCH校验器、Cache控制器和命中控制器;所述标记BCH编码器在进行Cache写访问时,对写入的Cache标记进行BCH编码,生成校验码,与Cache标记一起存入Cache标记存储器;所述Cache标记存储器用于存储Cache标记字和标记字的BCH校验码,所述Cache标记字包括Cache标记和行有效标志两部分;所述标记BCH校验器在进行Cache访问时,对Cache标记存储器输出的Cache标记及校验码进行BCH校验,生成校验错误标志,供命中控制器决定是否命中;所述数据BCH编码器在进行Cache写访问时,对输入数据进行BCH编码,生成校验码,与输入数据一起存入Cache数据存储器;所述Cache数据存储器用于存储Cache数据字和数据字的BCH校验码;所述数据BCH校验器在进行Cache读访问时,对Cache数据存储器输出的Cache数据及校验码进行BCH校验,生成校验错误标志,供命中控制器决定是否命中;所述Cache控制器根据输入的存储器地址对Cache标记存储器、Cache数据存储器的读写进行控制,根据输入的存储器地址与Cache标记判断Cache是否命中,输出命中标志,选择Cache数据输出;所述命中控制器根据Cache控制器的命中标志、标记BCH校验器的校验错误标志与数据BCH校验器的校验错误标志决定是否产生有效的Cache命中标志,在命中有效时将Cache控制器选择的Cache数据输出给处理器内核。

    2.  一种嵌入式微处理器高速缓存多位数据翻转错误的检测及容错方法,其特征在于:所述嵌入式微处理器高速缓存多位数据翻转错误的检测及容错装置包括标记BCH编码器、标记BCH校验器、数据BCH编码器、数据BCH校验器、Cache控制器、Cache标记存储器、Cache数据存储器和命中控制器;所述嵌入式微处理器高速缓存多位数据翻转错误的检测及容错装置采用如下步骤与方法对Cache中的数据错误进行检测与处理:
    (1)初始复位时,将Cache标记存储器中所有Cache标记均写入全0,所有行有效标志均置为无效,所有Cache标记字的BCH校验码均设置为有效的BCH校验码;
    (2)处理器进行存储器读或写访问时,Cache控制器根据存储器地址从 Cache标记存储器中读出Cache标记、行有效标志及BCH校验码,送标记BCH校验器进行BCH校验,如果BCH校验错误,强制命中控制器产生Cache不命中指示,由Cache控制器通过标记BCH编码器将Cache标记存储器中相应位置的Cache标记写入全0,行有效标志置为无效状态,并写入相应的BCH校验码,作废当前的Cache行,以后按照所使用的Cache管理策略重新装入该Cache行;如果Cache标记的BCH校验正确,分两种情况:处理器访问类型为存储器写访问时,转步骤(3),处理器访问类型为存储器读访问时,转步骤(4);
    (3)按照所使用的Cache管理策略,根据步骤(2)读出的Cache标记、行有效标志及存储器地址判断Cache是否命中,如果命中,将处理器送来的数据经数据BCH编码器形成BCH校验码后,和数据一起写入Cache数据存储器的相应位置,结束对Cache的操作;如果不命中,直接结束对Cache的操作;
    (4)Cache控制器按照所使用的Cache管理策略,根据步骤(2)读出的Cache标记、行有效标志及存储器地址判断Cache是否命中,如果不命中转步骤(5);如果命中,根据存储器地址从Cache数据存储器中读出Cache数据和BCH校验码,送数据BCH校验器进行BCH校验,如果校验正确,根据Cache管理策略,由命中控制器输出命中信号,选择正确的Cache数据送给处理器内核,结束对Cache的操作;如果BCH校验不正确,强制命中控制器产生Cache不命中,由Cache控制器通过标记BCH编码器将Cache标记存储器中相应位置的Cache标记写入全0,行有效标志置为无效状态,并写入相应的BCH校验码,作废当前的Cache行,以后按照所使用的Cache管理策略重新装入该Cache行,转步骤(5);
    (5)在读不命中时,Cache根据处理器内核送来的存储器地址,从主存储器中读取与Cache行大小相同数量的数据字,按照所使用的Cache管理策略,将数据字依次送数据BCH编码器生成数据字的BCH校验码,将数据字及生成的校验码一起写入Cache数据存储器的相应位置,然后由存储器地址生成Cache标记,将Cache标记及Cache行有效标志一起送标记BCH编码器生成标记字的BCH校验码,将Cache标记、Cache行有效标志及生成的BCH校验码一起写入Cache标记存储器相应位置,完成Cache行的更新。

    3.  根据权利要求2所述的嵌入式微处理器高速缓存多位数据翻转错误的检测及容错方法,其特征在于:所述Cache管理策略、映像规则选择直接映像、两路 组相联或四路组相联,不支持按写分配。

    4.  根据权利要求3所述的嵌入式微处理器高速缓存多位数据翻转错误的检测及容错方法,其特征在于:能够检测及容错的数据错误位数由所选择的BCH编码方式决定。

    关 键 词:
    高速缓存 数据 翻转 错误 检测 容错 装置 方法
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