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    广西11选5近1000期: 基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?pdf

    摘要
    申请专利号:

    广西11选5大小走势图 www.fnjpv.tw CN201510324252.4

    申请日:

    2015.06.12

    公开号:

    CN105007049A

    公开日:

    2015.10.28

    当前法律状态:

    实审

    有效性:

    审中

    法律详情: 实质审查的生效IPC(主分类):H03F 1/52申请日:20150612|||公开
    IPC分类号: H03F1/52 主分类号: H03F1/52
    申请人: 成都雷克尔科技有限公司
    发明人: 黄涛
    地址: 610000四川省成都市高新区锦城大道666号4栋8层2号
    优先权: 2014107146057 2014.11.28 CN
    专利代理机构: 代理人:
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201510324252.4

    授权公告号:

    |||

    法律状态公告日:

    2015.11.25|||2015.10.28

    法律状态类型:

    实质审查的生效|||公开

    摘要

    本发明公开了基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,主要由控制芯片AX,异或门集成芯片U1,电平采样?;さ缏?,控制开关报警电路,滤波放大电路,缓冲放大器电路和光束激发式逻辑放大电路组成,其特征在于,在光束激发式逻辑放大电路与VFO缓冲放大器电路之间还串接有逻辑?;ど浼詈鲜椒糯蟮缏?。本发明能够更好的对信号进行过滤与放大,大大提高了产品的适应能力与精准性,还能自动采集和识别配套终端设备的电平状态,自动连接安全支付设备与配套终端设备的通讯,从而有效避免因安全支付设备与配套终端设备电平不匹配而带来的缺陷。

    权利要求书

    权利要求书
    1.  基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,主要由控制芯片AX,与该控制芯片AX相连接的异或门集成芯片U1,与该异或门集成芯片U1相连接的电平采样?;さ缏?,分别与异或门集成芯片U1、电平采样?;さ缏芳翱刂菩酒珹X相连接的控制开关报警电路,以及串接在电平采样?;さ缏酚胍旎蛎偶尚酒琔1之间的VFO缓冲放大器电路和光束激发式逻辑放大电路组成,其特征在于,在光束激发式逻辑放大电路与VFO缓冲放大器电路之间还串接有串联设置的滤波放大电路(10)和逻辑?;ど浼詈鲜椒糯蟮缏?20);所述滤波放大电路(10)由三极管VT101,三极管VT102,三极管VT103,三极管VT104,三极管VT105,三极管VT106,三极管VT107,运算放大器P101,运算放大器P102,一端作为输入端、另一端与三极管VT107的基极相连接的电阻R101,与电阻R101并联的电容C101,一端与三极管VT107的基极相连接、另一端经电阻R105后与三极管VT107的发射极相连接的电阻R103,一端与三极管VT107的基极相连接、另一端经电阻R104后与三极管VT107的集电极相连接的电阻R102,正极与三极管VT107的发射极相连接、负极与电阻R103和电阻R105的连接点相连接的电容C104,串接在三极管VT101的基极与发射极之间的电阻R114,一端接地、另一端与三极管VT102的基极相连接的电阻R113,P极与三极管VT103的基极相连接、N极经电容C103后与三极管VT107的集电极相连接的二极管D101,P极经二极管D102后与二极管D101的N极相连接、N极与三极管VT106的基极相连接的二极管D103,串接在三极管VT106的基极与集电极之间的电阻R111,一端接地、另一端与三极管VT104的发射极相连接的电阻R112,负极接地、正极经电阻R106后与电容C104的正极相连接的电容C105,一端与电容C105的正极相连接、另一端与运算放大器P101的负输入端相连接的电阻R108,一端与电容C105的正极相连接、另一端与运算放大器P101的输出端相连接的电阻R107,串接在运算放大器P101的负输入端与输出端之间的电容C106,负极接地、正极与运算放大器P102的正输入端相连接的电容C108,负极经电阻R109后与运算放大器P101的输出端相连接、正极与运算放大器P102的负输入端相连接的电容C107,一端与电容C107的负极相 连接、另一端与电容C108的正极相连接的电阻R110,以及负极与三极管VT107的基极相连接、正极经电阻R115后与三极管VT104的发射极相连接的电容C102组成;其中,电容C104的负极还同时与三极管VT106的集电极和三极管VT105的集电极相连接,三极管VT101的发射极、三极管VT103的集电极和三极管VT104的集电极均与电阻R102和电阻R104的连接点相连接,三极管VT101的基极与三极管VT102的发射极相连接,三极管VT101的集电极与三极管VT102的基极相连接,三极管VT102的集电极与三极管VT103的基极相连接,三极管VT103的发射极与三极管VT104的基极相连接,三极管VT104的发射极与三极管VT105的发射极相连接,三极管VT105的基极与三极管VT106的发射极相连接,运算放大器P101的正输入端接地,电容C107的正极还同时与运算放大器P102的输出端以及二极管D101的N极相连接,所述三极管VT104的发射极作为输出端;
    所述光束激发式逻辑放大电路主要由功率放大器P1,与非门IC1,与非门IC2,与非门IC3,负极与功率放大器P1的同相端相连接、正极经光二极管D4后接地的极性电容C4,一端与极性电容C4的正极相连接、另一端经二极管D5后接地的电阻R13,正极与电阻R13和二极管D5的连接点相连接、负极接地的极性电容C6,一端与与非门IC1的负极输入端相连接、另一端与功率放大器P1的同相端相连接的电阻R14,串接在功率放大器P1的反相端与输出端之间的电阻R15,一端与与非门IC1的输出端相连接、另一端与与非门IC3的负极输入端相连接的电阻R16,正极与与非门IC2的输出端相连接、负极与与非门IC3的负极输入端相连接的电容C5,以及一端与极性电容C6的正极相连接、另一端与与非门IC2的负极输入端相连接的电阻R17组成;所述与非门IC1的正极输入端与功率放大器P1的反相端相连接,其输出端与与非门IC2的正极输入端相连接,与非门IC3的正极输入端则与功率放大器P的输出端相连接;所述VFO缓冲放大器电路由三极管Q4,三极管Q5,一端与三极管Q4的基极相连接、另一端经电容C1后与与非门IC3的输出端相连接的电阻R8,一端与三极管Q4的基极相连接、另一端顺次经电阻R12和电容C3后与异或门集成芯片U1相连接的 电阻R11,一端与三极管Q4的基极相连接、另一端与电阻R12和电容C3的连接点相连接的电阻R10,以及一端与三极管Q4的集电极相连接、另一端经电容C2后接地的电阻R9组成;所述三极管Q5的发射极与电阻R10与电阻R12的连接点相连接,其集电极与电阻R9和电容C2的连接点相连接,其基极与三极管Q4的集电极相连接;所述三极管Q4的发射极接地,且三极管Q5的集电极还外接+9v~12V的直流电压VCC;功率放大器P1的正极输入端则与电平采样?;さ缏废嗔?;所述逻辑?;ど浼詈鲜椒糯蟮缏分饕扇躋6,三极管Q7,功率放大器P2,功率放大器P3,串接在功率放大器P2的反相端与输出端之间的电阻R19,串接在功率放大器P3的同相端与输出端之间的极性电容C9,串接在功率放大器P2的同相端与三极管Q6的集电极之间的电阻R18,串接在三极管Q6的集电极与三极管Q7的基极之间的电阻R20,与电阻R20相并联的电容C8,负极与功率放大器P2的同相端相连接、正极经电阻R21后与三极管Q6的发射极相连接的极性电容C7,串接在三极管Q7的基极与极性电容C7的正极之间的电阻R22,正极与三极管Q7的发射极相连接、负极顺次经稳压二极管D6和电阻R23后与功率放大器P2的输出端相连接的电容C10,P极与功率放大器P3的输出端相连接、N极经电阻R25和电阻R24后与稳压二极管D6与电阻R23的连接点相连接的二极管D7,以及P极与电容C10的负极相连接、N极与二极管D7与电阻R25的连接点相连接的稳压二极管D8组成;所述三极管Q6的基极与极性电容C7的正极相连接,其发射极与三极管Q7的发射极相连接,其集电极与功率放大器P2的反相端相连接;三极管Q7的集电极与功率放大器P3的反相端相连接,功率放大器P3的同相端与功率放大器P2的输出端相连接;所述极性电容C7的正极与与非门IC3的负极输入端相连接,而电阻R25与电阻R24的连接点则与电阻R101的输入端相连接。

    2.  根据权利要求1所述的基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,其特征在于,所述控制开关报警电路由基极与异或门集成芯片U1的一个输入端相连接、集电极经电阻R4后与控制芯片AX的FB管脚相连接、而发射极则经电阻R5后与异或门集成芯片U1的输出端相连接的三极管Q1,基极 与三极管Q1的集电极相连接、其集电极直接与控制芯片AX的FB管脚相连接、而其发射极则经电阻R6后与报警器HA的正极相连接的三极管Q2,以及基极经电阻R8后与电平采样?;さ缏废嗔?、其集电极经二极管D3后与报警器HA的正极相连、而其发射极则经电阻R7后与控制芯片AX的SW管脚相连接的三极管Q3组成;所述异或门集成芯片U1的输出端还分别与报警器HA的负极和控制芯片AX的EN管脚相连接。

    3.  根据权利要求2所述的基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,其特征在于:所述的电平采样?;さ缏酚上嗷ゴ牡缱鑂2和电阻R1,相互串接的二极管D1和二级管D2,以及一端与功率放大器P1的同相端相连接、另一端则与二极管D2的P极相连接的电阻R3组成;所述二极管D2和二极管D1的连接点,以及电阻R2与电阻R1的连接点还均与三极管Q1的基极相连接,电阻R2的另一端则经电阻R8后与三极管Q3的基极相连接。

    4.  根据权利要求1~3任一项所述的基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,其特征在于:所述控制芯片AX的型号为AX2003型。

    5.  根据权利要求4所述的基于VFO缓冲放大器的逻辑?;ぢ瞬ǚ糯笞远ň低?,其特征在于:所述异或门集成芯片U1的型号为74HC86型。

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    基于 VFO 缓冲放大器 逻辑 ?;?滤波 放大 自动 报警 系统
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