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    广西11选5同步开奖结果查询: 对电子装置执行存储接口控制的方法及其装置.pdf

    摘要
    申请专利号:

    广西11选5大小走势图 www.fnjpv.tw CN201510097844.7

    申请日:

    2015.03.05

    公开号:

    CN104899165A

    公开日:

    2015.09.09

    当前法律状态:

    授权

    有效性:

    有权

    法律详情: 授权|||实质审查的生效IPC(主分类):G06F 13/16申请日:20150305|||公开
    IPC分类号: G06F13/16 主分类号: G06F13/16
    申请人: 联发科技股份有限公司
    发明人: 陈尚斌; 谢博伟
    地址: 中国台湾新竹科学工业园区新竹市笃行一路一号
    优先权: 61/948,569 2014.03.06 US; 14/535,299 2014.11.06 US
    专利代理机构: 深圳市威世博知识产权代理事务所(普通合伙)44280 代理人: 李庆波
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201510097844.7

    授权公告号:

    ||||||

    法律状态公告日:

    2018.03.13|||2015.10.07|||2015.09.09

    法律状态类型:

    授权|||实质审查的生效|||公开

    摘要

    本发明提供一种对电子装置执行存储接口控制的方法及其装置。所述方法包括以下步骤:当检测到数据信号和时钟信号之间的相位差达到预定值时,控制时钟信号从第一频率切换至第二频率;对数据信号进行至少一次相移,直到满足预定条件,其中,在时钟信号从第一频率切换至第二频率后,对数据信号进行至少一次相移;以及控制时钟信号从第二频率切换至第一频率,其中,在对数据信号进行至少一次相移之后,时钟信号从第二频率切换至第一频率;其中,存储接口电路通过至少一次相移从而被校准。本发明提供的对电子装置执行存储接口控制的方法及其装置,以恰当地解决信号的偏移问题,以保证电子装置的整体性能。

    权利要求书

    权利要求书
    1.  一种对电子装置执行存储接口控制的方法,其特征在于,所述方法包括以下步骤:
    当检测到数据信号和时钟信号之间的相位差达到预定值时,控制所述时钟信号从第一频率切换至第二频率,其中,所述时钟信号和所述数据信号均为所述电子装置的存储接口电路中的信号,且所述存储接口电路用于控制所述电子装置的随机存取存储器;
    对所述数据信号进行至少一次相移,直到满足预定条件,其中,在所述时钟信号从所述第一频率切换至所述第二频率后,对所述数据信号进行所述至少一次相移;以及
    控制所述时钟信号从所述第二频率切换至所述第一频率,其中,在对所述数据信号进行所述至少一次相移之后,所述时钟信号从所述第二频率切换至所述第一频率;
    其中,所述存储接口电路通过所述至少一次相移从而被校准。

    2.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,所述第一频率为所述第二频率的倍数;而且所述第一频率与所述第二频率的比值等于大于1的正整数。

    3.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,进一步包括:
    当检测到所述时钟信号和所述数据信号之间的所述相位差达到所述预定值时,沿时间轴以一个放大因子对所述数据信号的局部波形进行放大;
    其中,在沿所述时间轴以所述放大因子对所述数据信号的所述局部波形进行放大后,对所述数据信号进行所述至少一次相移。

    4.  如权利要求3所述的对电子装置执行存储接口控制的方法,其特征在于,所述放大因子等于所述第一频率与所述第二频率的比值;且所述第一频率与所述第二频率的比值等于大于1的正整数。

    5.  如权利要求3所述的对电子装置执行存储接口控制的方法,其特 征在于,进一步包括:
    沿所述时间轴以一个收缩因子对所述数据信号的相关局部波形进行收缩,其中,所述相关局部波形对应于所述局部波形,且所述收缩因子为所述放大因子的倒数;
    其中,在对所述数据信号进行所述至少一次相移之后,沿所述时间轴以所述收缩因子对所述数据信号的所述相关局部波形进行收缩。

    6.  如权利要求5所述的对电子装置执行存储接口控制的方法,其特征在于,所述局部波形包括由所述数据信号搭载的对应于数据模式的至少两个脉冲;所述相关局部波形包括由所述数据信号搭载的对应于相关数据模式的至少两个脉冲;且所述相关数据模式对应于所述数据模式。

    7.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,所述至少一次相移的偏移量等于具有所述第一频率的所述时钟信号的周期的1/Ns,或等于具有所述第一频率的所述时钟信号的周期的1/Ns的倍数,其中Ns是大于1的正整数。

    8.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,对所述数据信号进行所述至少一次相移的步骤进一步包括:
    对所述数据信号进行所述至少一次相移,以使所述数据信号中的脉冲的上升沿和下降沿分别接近具有所述第二频率的所述时钟信号中的脉冲的上升沿和下降沿。

    9.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,对所述数据信号进行所述至少一次相移操作的步骤进一步包括:
    对所述数据信号进行所述至少一次相移,直到所述数据信号领先于或落后于所述时钟信号的状态被改变。

    10.  如权利要求1所述的对电子装置执行存储接口控制的方法,其特征在于,进一步包括:
    根据调制信号控制是否拉升或拉低所述时钟信号,其中,所述调制信号搭载一组二进制数据;和
    根据另一调制信号控制是否拉升或拉低所述数据信号,其中,所述另一调制信号搭载另一组二进制数据。

    11.  如权利要求10所述的对电子装置执行存储接口控制的方法,其特征在于,控制所述时钟信号从所述第一频率切换至所述第二频率的步骤进一步包括:
    通过对所述调制信号提供重复的二进制数据,以控制所述时钟信号从所述第一频率切换至所述第二频率。

    12.  如权利要求10所述的对电子装置执行存储接口控制的方法,其特征在于,进一步包括:
    当检测到所述时钟信号和所述数据信号之间的所述相位差达到所述预定值时,通过对所述另一调制信号提供重复的二进制数据,以沿时间轴利用放大因子对所述数据信号的局部波形进行放大;
    其中,沿时间轴利用放大因子对所述数据信号的局部波形进行放大后,对所述数据信号进行所述至少一次相移的操作。

    13.  如权利要求12所述的对电子装置执行存储接口控制的方法,其特征在于,对所述数据信号进行所述至少一次相移的操作的步骤进一步包括:
    通过对所述另一调制信号进行位移,以实现对所述数据信号进行所述至少一次相移的操作。

    14.  如权利要求10所述的对电子装置执行存储接口控制的方法,其特征在于,进一步包括:
    将对应于所述至少一次相移的位移量作为校准的参数,以校准所述存储接口电路,其中,在所述存储接口电路的校准之后,将所述位移量提供给所述数据信号所搭载的数据。

    15.  如权利要求10所述的对电子装置执行存储接口控制的方法,其特征在于,进一步包括:
    根据所述至少一次相移以调节所述存储接口电路中的延迟线的长度,从而校准所述存储接口电路,其中,所述延迟线的长度对应于所述延迟线中保持激活状态的多个延迟单元的数量。

    16.  一种对电子装置执行存储接口控制的装置,所述装置包括所述电子装置的至少一部分,其特征在于,所述装置包括:
    存储接口电路,位于所述电子装置的集成电路中,用以控制所述电子装置的随机存取存储器,其中,所述存储接口电路的信号包括时钟信号和数据信号;以及
    控制器,耦接于所述存储接口电路并设置在所述集成电路中,其中,当检测到所述数据信号和所述时钟信号之间的相位差达到预定值时,所述控制器控制所述时钟信号从第一频率切换至第二频率,并对所述数据信号进行至少一次相移,直到满足预定条件,其中,在所述时钟信号从所述第一频率切换至所述第二频率后,对所述数据信号进行所述至少一次相移,且所述控制器控制所述时钟信号从所述第二频率切换至所述第一频率,其中,在所述数据信号进行所述至少一次相移后,所述时钟信号从所述第二频率切换至所述第一频率;
    其中,所述控制器通过所述至少一次相移来校准所述存储接口电路。

    17.  一种对电子装置执行存储接口控制的装置,所述装置包括所述电子装置的至少一部分,其特征在于,所述装置包括:
    多个时钟缓冲器对,其串联地电连接在一起并设置在所述电子装置的集成电路的存储接口电路中,其中,所述多个时钟缓冲器对中的每个时钟缓冲器对包括设置在不同方向上的两个时钟缓冲器,所述两个时钟缓冲器中的一个位于一条普通传输路径上,所述普通传输路径用于分配所述集成电路的基准时钟信号至所述电子装置的随机存取存储器,所述两个时钟缓冲器中的另一个位于一条特殊传输路径上,所述特殊传输路径用以作为在所述存储接口电路的校准过程中毗邻所述普通传输路径的返回路径,且所述普通传输路径的末端作为所述特殊传输路径的起点;以及
    相位检测器,耦接于所述多个时钟缓冲对,并设置在所述集成电路中,用以对从所述特殊传输路径获取的所述基准时钟信号执行相位检测,以根据所述基准时钟信号的分配时间校准所述存储接口电路。

    18.  如权利要求17所述的对电子装置执行存储接口控制的装置,其特征在于,进一步包括:
    第一模拟延迟线,耦接于生成所述基准时钟信号的基准时钟源,并 位于所述普通传输路径的起点,用以延迟所述基准时钟信号并输出延迟后的基准时钟信号至所述普通传输路径上的第一时钟缓冲器,其中,所述模拟延迟线的长度是根据在所述存储接口电路的校准过程中所述相位检测器的至少一次相位检测结果而调节,且所述至少一次相位检测结果是根据从所述基准时钟源直接获取的所述基准时钟信号来测量的;以及
    第二模拟延迟线,耦接于所述相位检测器,并位于所述特殊传输路径的末端,用以延迟从位于所述特殊传输路径的最末端的时钟缓冲器获取的所述基准时钟信号。

    19.  如权利要求17所述的对电子装置执行存储接口控制的装置,其特征在于,进一步包括:
    第一模拟延迟线,耦接于生成所述基准时钟信号的基准时钟源,并位于所述普通传输路径的起点,用以延迟所述基准时钟信号并输出延迟后的基准时钟信号至所述普通传输路径的第一时钟缓冲器,其中,所述模拟延迟线的长度是根据在所述存储接口电路的校准过程中所述相位检测其的至少一次相位检测结果而调节,且所述至少一次相位检测结果是根据与累加偏移码相关联的变化后的基准时钟信号来测量的;以及
    第二模拟延迟线,耦接于所述相位检测器,并位于所述特殊传输路径的末端,用以延迟从位于所述特殊传输路径的最末端的时钟缓冲器获取的所述基准时钟信号。

    20.  如权利要求17所述的对电子装置执行存储接口控制的装置,其特征在于,进一步包括:
    第一直接数字合成子???,耦接于生成所述基准时钟信号的基准时钟源与所述普通传输路径的起点之间,用以对所述基准时钟信号执行直接数字合成操作以生成直接数字合成结果,并输出所述直接数字合成结果至所述普通传输路径的第一时钟缓冲器,其中,所述直接数字合成操作对应于在所述存储接口电路的校准过程中所述相位检测器的至少一次相位检测结果;
    第二直接数字合成子???,耦接于生成所述基准时钟信号的所述基准时钟源和所述相位检测器之间,用以对所述基准时钟执行另一直接数 字合成操作,以生成另一直接数字合成结果并输出所述另一直接数字合成结果至所述相位检测器;以及
    计算???,耦接于所述第一直接数字合成子??楹退鱿辔患觳馄髦?,用以根据所述至少一次相位检测结果进行计算,以生成至少一个计算结果,用于改变由所述第一直接数字合成子??樗葱械乃鲋苯邮趾铣刹僮?。

    21.  一种对电子装置执行存储接口控制的方法,其特征在于,所述方法包括以下步骤:
    利用多个时钟缓冲器对来传输所述电子装置的集成电路的基准时钟信号,所述多个时钟缓冲器对串联地电连接并设置在所述集成电路的存储接口电路中,其中,所述时钟缓冲器对中的每个时钟缓冲器对包括设置在不同方向上的两个时钟缓冲器,所述两个时钟缓冲器中的一个位于一条普通传输路径上,所述普通传输路径用以分配所述集成电路的所述基准时钟信号至所述电子装置的随机存取存储器,所述两个时钟缓冲器中的另一个位于一条特殊传输路径上,所述特殊传输路径用以作为在所述存储接口电路的校准过程中毗邻于所述普通传输路径的返回路径,且所述普通传输路径的末端被用作所述特殊传输路径的起点;以及
    利用所述集成电路中的相位检测器对从所述特殊传输路径获取的所述基准时钟信号执行相位检测,以根据所述基准时钟信号的分配时间校准所述存储接口电路。

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