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    广西11选5走势图官网: 用于FPGA验证平台的时钟电路.pdf

    摘要
    申请专利号:

    广西11选5大小走势图 www.fnjpv.tw CN201510622184.X

    申请日:

    2015.09.25

    公开号:

    CN105138070A

    公开日:

    2015.12.09

    当前法律状态:

    授权

    有效性:

    有权

    法律详情: 授权|||实质审查的生效IPC(主分类):G06F 1/08申请日:20150925|||公开
    IPC分类号: G06F1/08; H03L7/08 主分类号: G06F1/08
    申请人: 烽火通信科技股份有限公司
    发明人: 黄元波; 李恒
    地址: 430074湖北省武汉市东湖开发区光谷创业街67号
    优先权:
    专利代理机构: 北京捷诚信通专利事务所(普通合伙)11221 代理人: 王卫东
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201510622184.X

    授权公告号:

    ||||||

    法律状态公告日:

    2017.12.08|||2016.01.06|||2015.12.09

    法律状态类型:

    授权|||实质审查的生效|||公开

    摘要

    本发明公开了一种用于FPGA验证平台的时钟电路,包括FPGA和10G PHY芯片,还包括时钟缓冲器和时钟驱动器,线路恢复时钟经过第一时钟缓冲器分为两路,一路通过第一PLL变换成时钟g和时钟h,另一路为时钟d,时钟d通过第二PLL变换成PON口上行方向的参考时钟;时钟g经第二时钟缓冲器分为时钟r和时钟b,时钟r为SGMII的参考时钟,时钟b为FPGA的参考时钟;时钟h经第三时钟缓冲器分为XEXTCLK参考时钟和时钟s,时钟s为XAUI的参考时钟;PON逻辑时钟a、PON口下行方向的参考时钟j、时钟w以及PEXTCLK参考时钟均由时钟驱动器提供;时钟w通过第三PLL变换成PON口下行方向的参考时钟k。本发明显著降低了技术开发中的硬件成本和人力成本,有效的缩短了开发时间。

    权利要求书

    权利要求书
    1.  用于FPGA验证平台的时钟电路,包括FPGA和10GPHY芯片,其特征在于,还包括时钟缓冲器和时钟驱动器,
    FPGA输出的线路恢复时钟经过第一时钟缓冲器分为两路,一路时钟通过第一PLL变换频率成时钟g和时钟h,另一路时钟为时钟d,时钟d通过第二PLL变换频率成PON口上行方向的SerDes参考时钟n和PON口上行方向的SerDes参考时钟o,PON口上行方向的SerDes参考时钟n用于XG-PON系统、GPON系统和对称10GEPON系统,PON口上行方向的SerDes参考时钟o用于非对称10GEPON系统;
    时钟g经过第二时钟缓冲器分为时钟r和时钟b,时钟r为GPON系统的业务端口SGMII的SerDes参考时钟,时钟b为FPGA的参考时钟;
    时钟h经过第三时钟缓冲器分为10GPHY芯片的XEXTCLK参考时钟和时钟s,时钟s为XG-PON系统和10GEPON系统的业务端口XAUI的SerDes参考时钟;
    FPGA的PON逻辑时钟a、PON口下行方向的SerDes参考时钟j、时钟w以及10GPHY芯片的PEXTCLK参考时钟均由时钟驱动器提供,时钟w通过第三PLL变换频率成PON口下行方向的SerDes参考时钟k。

    2.  如权利要求1所述的用于FPGA验证平台的时钟电路,其特征在于,当用于所述XG-PON系统和所述GPON系统时,所述FPGA输出的线路恢复时钟为155.52MHz;当用于所述10GEPON系统时,所述线路恢复时钟为161.13MHz。

    3.  如权利要求1所述的用于FPGA验证平台的时钟电路,其特征在于,所述PON口下行方向的SerDes参考时钟j为155.52MHz,用于所述XG-PON系统和所述GPON系统;所述PON口下行方向的SerDes参考时钟k为103.125MHz,用于所述10GEPON系统。

    4.  如权利要求1所述的用于FPGA验证平台的时钟电路,其特征在于, 所述10GEPON系统包括所述对称10GEPON系统和所述非对称10GEPON系统。

    关 键 词:
    用于 FPGA 验证 平台 时钟 电路
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